ddr2和ddr3的区别(DDR2和DDR3有何不同)
一、DDR3与DDR2的介绍与不同
DDR2采用的新技术
除了以上所说的区别外，DDR2还引入了三项新的技术，它们是OCD、ODT和Post CAS。
OCD（Off-Chip Driver）：也就是所谓的离线驱动调整，DDR II通过OCD可以提高信号的完整性。DDR II通过调整上拉（pull-up）/下拉（pull-down）的电阻值使两者电压相等。使用OCD通过减少DQ-DQS的倾斜来提高信号的完整性；通过控制电压来提高信号品质。
ODT：ODT是内建核心的终结电阻器。我们知道使用DDR SDRAM的主板上面为了防止数据线终端反射信号需要大量的终结电阻。它大大增加了主板的制造成本。实际上，不同的内存模组对终结电路的要求是不一样的，终结电阻的大小决定了数据线的信号比和反射率，终结电阻小则数据线信号反射低但是信噪比也较低；终结电阻高，则数据线的信噪比高，但是信号反射也会增加。因此主板上的终结电阻并不能非常好的匹配内存模组，还会在一定程度上影响信号品质。DDR2可以根据自己的特点内建合适的终结电阻，这样可以保证最佳的信号波形。使用DDR2不但可以降低主板成本，还得到了最佳的信号品质，这是DDR不能比拟的。
Post CAS：它是为了提高DDR II内存的利用效率而设定的。在Post CAS操作中，CAS信号（读写/命令）能够被插到RAS信号后面的一个时钟周期，CAS命令可以在附加延迟（Additive Latency）后面保持有效。原来的tRCD（RAS到CAS和延迟）被AL（Additive Latency）所取代，AL可以在0，1，2，3，4中进行设置。由于CAS信号放在了RAS信号后面一个时钟周期，因此ACT和CAS信号永远也不会产生碰撞冲突。
总的来说，DDR2采用了诸多的新技术，改善了DDR的诸多不足，虽然它目前有成本高、延迟慢能诸多不足，但相信随着技术的不断提高和完善，这些问题终将得到解决。
DDR3与DDR2几个主要的不同之处
1．突发长度（Burst Length，BL）
由于DDR3的预取为8bit，所以突发传输周期（Burst Length，BL）也固定为8，而对于DDR2和早期的DDR架构系统，BL=4也是常用的，DDR3为此增加了一个4bit Burst Chop（突发突变）模式，即由一个BL=4的读取操作加上一个BL=4的写入操作来合成一个BL=8的数据突发传输，届时可通过A12地址线来控制这一突发模式。而且需要指出的是，任何突发中断操作都将在DDR3内存中予以禁止，且不予支持，取而代之的是更灵活的突发传输控制（如4bit顺序突发）。
2．寻址时序（Timing）
就像DDR2从DDR转变而来后延迟周期数增加一样，DDR3的CL周期也将比DDR2有所提高。DDR2的CL范围一般在2～5之间，而DDR3则在5～11之间，且附加延迟（AL）的设计也有所变化。DDR2时AL的范围是0～4，而DDR3时AL有三种选项，分别是0、CL-1和CL-2。另外，DDR3还新增加了一个时序参数——写入延迟（CWD），这一参数将根据具体的工作频率而定。
3．DDR3新增的重置（Reset）功能
重置是DDR3新增的一项重要功能，并为此专门准备了一个引脚。DRAM业界很早以前就要求增加这一功能，如今终于在DDR3上实现了。这一引脚将使DDR3的初始化处理变得简单。当Reset命令有效时，DDR3内存将停止所有操作，并切换至最少量活动状态，以节约电力。
在Reset期间，DDR3内存将关闭内在的大部分功能，所有数据接收与发送器都将关闭，所有内部的程序装置将复位，DLL（延迟锁相环路）与时钟电路将停止工作，而且不理睬数据总线上的任何动静。这样一来，将使DDR3达到最节省电力的目的。
4．DDR3新增ZQ校准功能
ZQ也是一个新增的脚，在这个引脚上接有一个240欧姆的低公差参考电阻。这个引脚通过一个命令集，通过片上校准引擎（On-Die Calibration Engine，ODCE）来自动校验数据输出驱动器导通电阻与ODT的终结电阻值。当系统发出这一指令后，将用相应的时钟周期（在加电与初始化之后用512个时钟周期，在退出自刷新操作后用256个时钟周期、在其他情况下用64个时钟周期）对导通电阻和ODT电阻进行重新校准。
5．参考电压分成两个
在DDR3系统中，对于内存系统工作非常重要的参考电压信号VREF将分为两个信号，即为命令与地址信号服务的VREFCA和为数据总线服务的VREFDQ，这将有效地提高系统数据总线的信噪等级。
6．点对点连接（Point-to-Point，P2P）
这是为了提高系统性能而进行的重要改动，也是DDR3与DDR2的一个关键区别。在DDR3系统中，一个内存控制器只与一个内存通道打交道，而且这个内存通道只能有一个插槽，因此，内存控制器与DDR3内存模组之间是点对点（P2P）的关系（单物理Bank的模组），或者是点对双点（Point-to-two-Point，P22P）的关系（双物理Bank的模组），从而大大地减轻了地址/命令/控制与数据总线的负载。而在内存模组方面，与DDR2的类别相类似，也有标准DIMM（台式PC）、SO-DIMM/Micro-DIMM（笔记本电脑）、FB-DIMM2（服务器）之分，其中第二代FB-DIMM将采用规格更高的AMB2（高级内存缓冲器）。
二、DDR3内存和DDR2内存有什么区别
DDR2和DDR3的插槽是不一样的，DDR3比DDR2频率高，速度快，容量大，性能高。
既支持DDR2内存卡还支持DDR3内存卡的主板，其中2个是DDR2内存卡的插槽，另外2个是DDR3内存卡的插槽，但是不能同时使用2种类型的，只能选择1种。
DDR3 SDRAM（Double-Data-Rate Three Synchronous Dynamic Random Access Memory），是一种电脑存储器规格。它属于SDRAM家族的存储器产品，提供相较于DDR2 SDRAM更高的运行性能与更低的电压，是DDR2 SDRAM（四倍数据率同步动态随机存取存储器）的后继者（增加至八倍）。
DDR2内存卡与DDR3内存卡的区别如下：
1、防呆缺口不一样：
DDR2内存单面金手指120个（双面240个），缺口左边为64个针脚，缺口右边为56个针脚。
DDR3内存单面金手指也是120个（双面240个），缺口左边为72个针脚，缺口右边为48个针脚。
2、读取数据的速度不一样：
DDR2内存卡预读取能力为4bit数据读预取。
DDR3内存卡预读取能力为16bit数据读预取。
3、使用电压不同：
DDR2内存卡的使用电压为1.8V。
DDR3内存卡的使用电压为1.5V。
参考资料：百度百科-DDR3内存
参考资料：百度百科-DDR2内存
三、DDR和DDR2,DDR3,区别在那里
DDR：
DDR采用一个周期来回传递一次数据，因此传输在同时间加倍，因此就像工作在两倍的工作频率一样。为了直观，以等效的方式命名，因此命名为DDR 200 266 333 400。
DDR2：
DDR2尽管工作频率没有变化，数据传输位宽由DDR的2bit变为4bit，那么同时间传递数据是DDR的两倍，因此也用等效频率命名，分别为DDR2 400 533 667 800。
DDR3：
DDR3内存也没有增加工作频率，继续提升数据传输位宽变为8bit，为DDR2两倍，因此也在同样工作频率下达到更高带宽，因此用等效方式命名DDR3 800 1066 1333 1600。
所以可以看到，如DDR 400 DDR2 800 DDR3 1600内存工作频率没有区别，只是由于传输数据位宽倍增，导致带宽的增加。
而内存的真正工作频率决定于延迟，DDR400与DDR2 800真实工作频率相同，后者带宽是前者一倍，延迟上一样。如果是DDR400与DDR2 667，那后者虽然带宽更大，不过其真实频率反而低一些，延迟上略大。
DDR2与DDR的区别：
1、速率与预取量
DDR2的实际工作频率是DDR的两倍，DDR2内存拥有两倍于标准DDR内存的4bit预期能力。
2、封装与电压
DDR封装为TSOPII，DDR2封装为FBGA；
DDR的标准电压为2.5V，DDR2的标准电压为1.8V。
3、bit pre-fetch
DDR为2bit pre-fetch，DDR2为4bit pre-fetch。
4、新技术的引进
DDR2引入了OCD、ODT和POST
（1）ODT：ODT是内建核心的终结电阻，它的功能是让DQS、RDQS、DQ和DM信号在终结电阻处消耗完，防止这些信号在电路上形成反射；
（2）Post CAS：它是为了提高DDR2内存的利用效率而设定的；
在没有前置CAS功能时，对其他L-Bank的寻址操作可能会因当前行的CAS命令占用地址线而延后，并使数据I/O总线出现空闲，当使用前置CAS后，消除了命令冲突并使数据I/O总线的利率提高。
（3）OCD（Off-Chip Driver）：离线驱动调整，DDR2通过OCD可以提高信号的完整性 OCD的作用在于调整DQS与DQ之间的同步，以确保信号的完整与可靠性，OCD的主要用意在于调整I/O接口端的电压，来补偿上拉与下拉电阻值，目的是让DQS与DQ数据信号间的偏差降低到最小。
调校期间，分别测试DQS高电平和DQ高电平，与DQS低电平和DQ高电平时的同步情况，如果不满足要求，则通过设定突发长度的地址线来传送上拉/下拉电阻等级，直到测试合格才退出OCD操作。
DDR3与DDR2的区别：
1、DDR2为1.8V，DDR3为1.5V；
2、DDR3采用CSP和FBGA封装，8bit芯片采用78球FBGA封装，16bit芯片采用96球FBGA封装，而DDR2则有60/68/84球FBGA封装三种规格；
3、逻辑Bank数量，DDR2有4Bank和8Bank，而DDR3的起始Bank8个；
4、突发长度，由于DDR3的预期为8bit,所以突发传输周期（BL，Burst Length）也固定位8，而对于DDR2和早期的DDR架构的系统，BL=4也是常用的；
DDR3为此增加了一个4-bitBurst Chop（突发突变）模式，即由一个BL=4的读取操作加上一个BL=4的写入操作来合成一个BL=8的数据突发传输，届时可通过A112位地址线来控制这一突发模式；
5、寻址时序（Timing），DDR2的AL为0~4，DDR3为0、CL-1和CL-2，另外DDR3还增加了一个时序参数——写入延迟（CWD）；
6、bit pre-fetch：DDR2为4bit pre-fetch,DDR3为8bit pre-fetch；
7、新增功能，ZQ是一个新增的引脚，在这个引脚上接有240欧姆的低公差参考电阻，新增裸露SRT（Self-Reflash Temperature）可编程化温度控制存储器时钟频率功能。
新增PASR（PartialArray Self-Refresh）局部Bank刷新的功能，可以说针对整个存储器Bank做更有效的数据读写以达到省电功效；
8、DDR3的参考电压分成两个，即为命令与地址信号服务的VREFCA和为数据总线服务的VREFDQ，这将有效低提高系统数据总线的信噪等级；
9、点对点连接（point-to-point,p2p），这是为了提高系统性能而进行的重要改动。